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更新于 9月12日

先進封裝光刻膠技術研發(fā)工程師(FOPLP/CoPoS方向)

1.5-3萬
  • 南通通州區(qū)
  • 3-5年
  • 碩士
  • 全職
  • 招1人

職位描述

FOPLPCOPOS芯片封裝封裝工藝電子/半導體/集成電路
【公司簡介】??
我們是一家聚焦于先進半導體封裝技術的創(chuàng)新型企業(yè),致力于為AI、高性能計算(HPC)、數(shù)據(jù)中心等領域提供高性能、高可靠性的封裝解決方案。當前核心方向為??FOPLP(扇出型面板級封裝)??與??CoPoS(Chip on Panel Substrate)??技術研發(fā),已實現(xiàn)2微米線寬線距(2μm L/S)的先進封裝工藝突破,產(chǎn)品可滿足下一代AI芯片、GPU、ASIC等高性能器件的封裝與模組需求。公司匯聚全球頂尖半導體人才,擁有完善的研發(fā)平臺與產(chǎn)業(yè)鏈資源,現(xiàn)因業(yè)務快速發(fā)展,誠邀光刻膠領域技術精英加入!
??【崗位職責】??
??1、光刻膠材料研發(fā)??:負責先進封裝(FOPLP/CoPoS)用光刻膠材料的配方設計與優(yōu)化,重點突破2μm線寬線距工藝下的高分辨率、低缺陷率、高靈敏度等技術指標。
2、工藝協(xié)同開發(fā)??:與封裝工藝團隊(曝光、顯影、刻蝕等)緊密協(xié)作,優(yōu)化光刻工藝窗口(如曝光能量、顯影時間、溫度等),提升良率與一致性。
3、性能驗證與表征??:主導光刻膠材料的性能測試(如分辨率、線寬均勻性、耐刻蝕性、熱穩(wěn)定性等),利用SEM、AFM、XPS等工具分析失效模式,推動材料迭代。
4、技術難題攻關??:解決FOPLP/CoPoS工藝中光刻膠相關的關鍵技術問題(如面板級均勻性、多層堆疊兼容性、高深寬比圖形化等)。
5、跨部門協(xié)作??:對接封裝設計、生產(chǎn)制造、質量檢測團隊,推動光刻膠技術與封裝工藝的匹配落地,支持客戶樣品導入與量產(chǎn)。
【任職要求】??
1、教育背景??:材料科學、化學工程、半導體物理、電子化學品等相關專業(yè)碩士及以上學歷,博士優(yōu)先。
2、?經(jīng)驗要求??:3年以上半導體光刻膠研發(fā)經(jīng)驗,有??先進封裝(FOPLP、CoWoS、EMC等)??或??高密度互連(HDI)??領域光刻膠開發(fā)經(jīng)驗者優(yōu)先;熟悉2μm及以下線寬線距工藝者優(yōu)先。
3、技術能力??:
(1)深入理解光刻膠化學原理(如化學放大膠CAR、i-line、KrF等體系),掌握光刻工藝(曝光、顯影、后烘)與材料特性的關聯(lián);
(2)熟悉半導體封裝制程(如晶圓級封裝WLP、面板級封裝FOPLP),了解2μm線寬線距工藝的關鍵挑戰(zhàn)(如翹曲控制、材料應力);
(3)精通材料表征技術(SEM/TEM、AFM、XPS、接觸角測量等),能獨立分析光刻膠性能與失效原因;
(4)熟悉行業(yè)技術趨勢(如AI/HPC對封裝的高帶寬、低功耗需求),具備前瞻性技術布局能力。
4、綜合素養(yǎng)??:優(yōu)秀的邏輯分析與問題解決能力,能主導跨部門項目;良好的英語讀寫能力(需閱讀國際文獻/專利);具備專利撰寫或技術論文發(fā)表經(jīng)驗者優(yōu)先。
【?我們提供】??
1、有競爭力的薪酬??:年薪20萬-60萬(具體面議),包含績效獎金與項目跟投機會。
2、研發(fā)資源支持??:配備先進的材料合成與表征實驗室(如光刻膠涂布機、曝光機、納米壓印設備等)。
??3、職業(yè)發(fā)展空間??:參與前沿技術攻關,直接向研發(fā)總監(jiān)匯報,快速成長為領域專家。
4、福利體系??:六險一金、彈性工作制、年度體檢、帶薪培訓、員工股權激勵計劃。
5、行業(yè)資源??:與頭部晶圓廠、封裝廠及學術機構深度合作,參與國際技術論壇與展會。
我們期待與熱愛半導體封裝技術的您共同定義下一代高性能計算的核心基石!?

工作地點

南通通州區(qū)江海圓夢谷

職位發(fā)布者

沈女士/人事經(jīng)理

昨日活躍
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公司Logo制局半導體(江蘇)有限公司
制局半導體憑借強大的實力與卓越的戰(zhàn)略布局,在江蘇常州及南通均設有公司,其中制局半導體(南通)有限公司是制局半導體(江蘇)有限公司全資子公司。擁有雄厚的實力及廣闊的發(fā)展前景,無論是常州的文化底蘊與現(xiàn)代活力,還是南通的獨特風情與發(fā)展機遇,都能滿足您對生活的多元追求??梢愿鶕?jù)自身的職業(yè)規(guī)劃、生活偏好等因素,綜合權衡后做出最適合自己的抉擇。我們熱忱歡迎您加入制局大家庭,一同在這里鑄就輝煌的職業(yè)篇章,實現(xiàn)自己的人生價值。期待您的踴躍投遞,開啟您在制局半導體的精彩職業(yè)生涯之旅!制局半導體團隊自2015年歸國后,始終致力于為客戶提供優(yōu)質異構系統(tǒng)集成模組整體解決方案,含設計、仿真、先進封裝制造、功能認證、性能測試,2016年即完成行業(yè)首條線寬線距5微米FOPLP生產(chǎn)線通線并商用交單。制局半導體以小芯片設計和先進封裝制造為基礎的異構系統(tǒng)集成方案是集成電路后摩爾時代產(chǎn)業(yè)可持續(xù)高速增長方向。根據(jù)Yole的預測,高端封裝市場規(guī)模將從2023年的43億美元增長至2029年的280億美元,年增長達37%。根據(jù)martket.us的預測,全球Chiplet市場規(guī)模將由2023年的31億美元增長至2033年的1070億美元,年增長約42.5%。制局半導體是小芯片和異構集成技術先行者,提供系統(tǒng)芯片及模組整體解決方案,涵蓋硅介質層或玻璃基板 2.5D模組;高密度扇出多層重布線的模組;橋接功能模組。項目技術平臺融合FOPLP、Bumping、TSV/TGV、2.5/3D、Embedded等,實現(xiàn)PMIC、射頻、SiC、GaN、GPU、CPU模組制造。制局FOPLP技術在提升芯片功能密度、縮短互聯(lián)長度以及進行系統(tǒng)重構等方面均展現(xiàn)出顯著優(yōu)勢,符合AI時代對芯片性能要求。
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