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研發(fā)區(qū)域1：
1、檢查DRM準(zhǔn)確性和完備性，根據(jù)DRM撰寫DRC Deck
2、根據(jù)DRM、繪制DRC QA Pattern，對DRC Deck進(jìn)行QA，保證DRC正確性
3、根據(jù)DRM，撰寫Antenna DRC檢查天線效應(yīng)
4、根據(jù)Logic Operation Table，撰寫LOTA Deck，并進(jìn)行檢查和QA
5、根據(jù)Dummy Rule，撰寫Dummy Insertion Deck，并進(jìn)進(jìn)行檢查和QA
研發(fā)區(qū)域2：
1、根據(jù)Sample GDS，開發(fā)/修改 Pcell CDF/Layout/Callback等相關(guān)文件
2、根據(jù)DRC/LVS Deck 對開發(fā)的Pcell進(jìn)行檢查和驗(yàn)證
3、根據(jù)Spec Table 驗(yàn)證 CDF 仿真參數(shù)的正確性，確保Spec和hsp能夠正常仿真，同時對callback進(jìn)行反標(biāo)驗(yàn)證
4、根據(jù)DRM、CAD Layer table等文件完成Techfile,display、layermap文件的開發(fā)及驗(yàn)證
5、打包、整合并發(fā)布PDK Library
研發(fā)區(qū)域3：
1、Model TSk Design，根據(jù)平臺器件種類和PDK deck 完成TSK 設(shè)計(jì)和檢查
2、Model 測試，根據(jù)器件種類及模型需求完成測試及數(shù)據(jù)檢
3、與PlE/Device同事溝通Model Tarqet & SPEC，確保建模輸入件的合理性和完備性
4、有源器件模型開發(fā)，基于CMC Model完成MOS、Diode BJT Model開發(fā)和質(zhì)量檢查
5、無源器件模型開發(fā)，基于Subckt Model 完成MIM.MOM、MOSCAP、Resistor等模型開發(fā)和質(zhì)量檢查
6、Model Library Merge & Final QA, Model Usage Document編寫
7、技術(shù)支持，解決用戶在Model使用過程中遇到的問題并提供技術(shù)支持和解決方案
研發(fā)區(qū)域4：
1、PEX Deck開發(fā)，開發(fā)PEX工藝文件，確保其與Silicon 工藝和電性匹配，能準(zhǔn)確反應(yīng) Silicon Rc delay 狀況
2、PEX testkey 設(shè)計(jì)與tapeout，以及測試驗(yàn)證
3、PEX 驗(yàn)證，確保各層連接、mappingl以及device 屬性無問題，驗(yàn)證PEX與Silicon實(shí)際電性match
4、PEX 維護(hù)，根據(jù)工藝更新持續(xù)進(jìn)版與debug
要求：211本科及以上學(xué)歷優(yōu)先，年齡35歲以內(nèi)，男女不限，有以上區(qū)域研發(fā)經(jīng)驗(yàn)優(yōu)先，可接受應(yīng)屆生，五險(xiǎn)一金，五天八小時，雙休，法休，節(jié)假日福利
微電子，集成電路專業(yè)、計(jì)算機(jī)或者物理專業(yè)，有編程經(jīng)驗(yàn)優(yōu)先，有PDK使用經(jīng)驗(yàn)更佳，有器件建?；蛘唠娐吩O(shè)計(jì)經(jīng)驗(yàn)更佳，有RC建?；蛘唠娐吩O(shè)計(jì)經(jīng)驗(yàn)更佳；
薪酬福利：薪酬根據(jù)面試情況和經(jīng)驗(yàn)來定，薪酬范圍：8K-20K之間；