職位描述
AI芯片SoC芯片ASIC芯片人工智能電子/半導(dǎo)體/集成電路
崗位職責(zé)：
1、負(fù)責(zé)模塊級和全芯片級電路的邏輯綜合，形式驗證；
2、負(fù)責(zé)模塊級和全芯片級設(shè)計的時鐘分析、SDC定義，時序報告分析，STA signoff等工作；
3、負(fù)責(zé)RTL、NETLIST、SDC質(zhì)量檢查；
4、負(fù)責(zé)邏輯綜合、形式驗證等flow的維護(hù)更新和升級；
5、負(fù)責(zé)頂層和模塊級的UPF的生成與相關(guān)檢查；
6、與后端PR團(tuán)隊合作，支持后端layout和時序收斂。
任職要求：
1、熟練使用業(yè)界主流EDA工具，DC/PT/Formality/Spyglass等；
2、熟悉Linux環(huán)境，熟練使用Tcl/Perl/Python腳本編程；
3、熟悉SoC設(shè)計綜合開發(fā)流程；
4、有高速接口IP的綜合，時序分析收斂經(jīng)驗者優(yōu)先；
5、具備良好的溝通與協(xié)調(diào)能力，良好的團(tuán)隊合作意識，強(qiáng)烈的責(zé)任感及進(jìn)取精神。
1、負(fù)責(zé)模塊級和全芯片級電路的邏輯綜合，形式驗證；
2、負(fù)責(zé)模塊級和全芯片級設(shè)計的時鐘分析、SDC定義，時序報告分析，STA signoff等工作；
3、負(fù)責(zé)RTL、NETLIST、SDC質(zhì)量檢查；
4、負(fù)責(zé)邏輯綜合、形式驗證等flow的維護(hù)更新和升級；
5、負(fù)責(zé)頂層和模塊級的UPF的生成與相關(guān)檢查；
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4、有高速接口IP的綜合，時序分析收斂經(jīng)驗者優(yōu)先；
5、具備良好的溝通與協(xié)調(diào)能力，良好的團(tuán)隊合作意識，強(qiáng)烈的責(zé)任感及進(jìn)取精神。
工作地點
岳麓區(qū)長沙半導(dǎo)體技術(shù)與應(yīng)用創(chuàng)新研究院
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職位發(fā)布者
姬先生/人力主管
昨日活躍立即溝通
廣東芯培森技術(shù)有限公司廣東芯培森技術(shù)有限公司創(chuàng)辦于2024年11月，主要從事面向原子級科學(xué)計算的算力芯片（APU）的研發(fā)和銷售。該團(tuán)隊于2022年研發(fā)出面向原子級科學(xué)計算的第一代"非馮·諾依曼"專用芯片架構(gòu)技術(shù)，并于2023年自主研制出基于第一代技術(shù)的服務(wù)器產(chǎn)品，經(jīng)多家第三方用戶實測，該產(chǎn)品在運行專用原子級科學(xué)計算時，同等精度和功耗下，相較高端GPU速度提升約1個數(shù)量級。目前，基于第一代技術(shù)的產(chǎn)品和服務(wù)已銷售至國內(nèi)外30多家企業(yè)、高校、科研院所。
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