職位描述
Verilog HDL通信/網(wǎng)絡設備
1、 根據(jù)研發(fā)任務需求，負責使用FPGA進行數(shù)字邏輯電路設計；
2、 熟悉xilinx或 Alter 的 FPGA系列之一，具有能熟練使用VHDL或Verilog來設計高速數(shù)字電路及運動控制功能；
3、 獨立完成電路模塊原理設計、樣板制作、調試及驗證；協(xié)助其他工程師完成項目轉產(chǎn)所需工作任務；
4、以及其他必要研發(fā)協(xié)助工作；
5、熟悉cPRI、JESD204B更佳
職位要求：
1、計算機、電子信息、自動化、生物醫(yī)學工程等相關專業(yè)，本科或以上學歷；需4年以上FPGA工程師工作經(jīng)驗；
2、精通模電、數(shù)電基礎知識，熟悉Quartus、ISE、Modelsim等軟件設計工具； 3、良好的團隊精神，有強烈的責任感和抗壓能力；
4、有通信行業(yè)從事經(jīng)驗優(yōu)先考慮，有數(shù)字信號處理經(jīng)驗者優(yōu)先考慮。
獎金績效
項目獎金
工作地點
西安雁塔區(qū)西京三號(東門)3號樓1501
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