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崗位職責： 1.負責FPGA系統(tǒng)的設計和開發(fā)工作，有Xilinx ZYNQ 7000系列芯片的FPGA系統(tǒng)開發(fā)經(jīng)驗的優(yōu)先。 2.參與高速信號采集系統(tǒng)的FPGA架構(gòu)設計，實現(xiàn)數(shù)據(jù)高速傳輸（如JESD204B、PCIe、DDR3/4接口）、實時信號處理算法（濾波、FFT、數(shù)字解調(diào)等）及低延遲控制邏輯開發(fā)； 3.根據(jù)項目需求，獨立進行模塊設計、FPGA代碼編寫（VHDL/Verilog）、仿真驗證、時序約束優(yōu)化及硬件調(diào)試，確保資源利用率與性能達標； 4.配合硬件團隊解決信號完整性、電源噪聲等問題，優(yōu)化FPGA與外圍電路協(xié)同工作性能； 5.開發(fā)ZYNQ PS端嵌入式程序（C/C++），實現(xiàn)ARM與FPGA邏輯的高效交互； 6.編寫設計文檔、測試報告及量產(chǎn)固件升級方案。 經(jīng)驗要求： 1.學歷與專業(yè)： 電子工程、通信工程、計算機科學等相關(guān)專業(yè)本科及以上學歷； 2.3年以上FPGA開發(fā)經(jīng)驗，有ZYNQ 7000系列（如XC7Z030/XC7Z045）項目開發(fā)經(jīng)驗者優(yōu)先； 3.熟悉高速數(shù)據(jù)采集系統(tǒng)開發(fā)，具備高速接口（如JESD204B、LVDS、Gigabit Ethernet、AXI4、PCIE）或通信協(xié)議（UART/SPI/I2C）實現(xiàn)經(jīng)驗； 4.精通Verilog/VHDL編程，掌握Xilinx Vivado開發(fā)工具鏈，熟悉IP核（如AXI DMA、DDR控制器）配置與集成； 5.熟悉ZYNQ架構(gòu)，具備PS-PL協(xié)同開發(fā)能力（如AXI總線交互、Linux驅(qū)動開發(fā)）； 6.掌握時序約束（SDC）、時序分析及資源優(yōu)化方法，具備高速邏輯調(diào)試經(jīng)驗； 7.熟悉示波器、邏輯分析儀等調(diào)試工具，能獨立完成FPGA功能驗證； 8.（加分項）了解數(shù)字信號處理算法（如FIR/IIR濾波器、數(shù)字上下變頻）的FPGA實現(xiàn)； 9.（加分項）有嵌入式Linux開發(fā)經(jīng)驗或Python/C++協(xié)同驗證經(jīng)驗。 10.軟性能力： 邏輯思維嚴謹，具備跨團隊協(xié)作能力，對復雜問題有快速定位與解決能力。