職位描述
Verilog HDL
職位描述
FPGA軟件工程師
崗位職責(zé)：
1、 參與衛(wèi)星通信、測(cè)控、數(shù)傳方案論證和設(shè)計(jì)；
2、 參與星地間測(cè)控/數(shù)傳算法的設(shè)計(jì)、仿真和調(diào)試；
3、 負(fù)責(zé)測(cè)控/數(shù)傳一體機(jī)FPGA代碼編寫與仿真；
4、 負(fù)責(zé)FPGA的資源及時(shí)序優(yōu)化，以滿足各種需要的功能及性能；
5、 負(fù)責(zé)算法設(shè)計(jì)文檔、測(cè)試報(bào)告的撰寫和整理工作。
任職要求：
1、 通信、測(cè)控、電子及相關(guān)專業(yè)5年以上經(jīng)驗(yàn)，碩士及以上學(xué)歷；
2、熟悉衛(wèi)星通信、測(cè)控的基本原理，掌握調(diào)制解調(diào)、擴(kuò)頻技術(shù)、信號(hào)捕獲等基本數(shù)字通信技術(shù)；
3、熟練使用matlab/simulink等仿真工具；
4、熟練使用VHDL、Verilog語言，有Xilinx/Actel FPGA實(shí)際項(xiàng)目開發(fā)經(jīng)驗(yàn)者優(yōu)先；
5、熟練使用各種儀器設(shè)備，如示波器、頻譜儀、邏輯分析儀等；
6、有擴(kuò)頻通信、測(cè)控通信等相關(guān)領(lǐng)域工作經(jīng)驗(yàn)優(yōu)先；
7、具有良好的溝通能力和團(tuán)隊(duì)合作精神，具有一定的抗壓能力。
8、有股權(quán)激勵(lì)
工作地點(diǎn)：哈爾濱/深圳/青島
薪金：10K - 30K
工作地點(diǎn)
青島黃島區(qū)城發(fā)商業(yè)中心
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深圳大儀加行科技有限公司關(guān)于我們Hello World，我們是大儀Da Instruments，一家專注于電子測(cè)試系統(tǒng)級(jí)行業(yè)落地的創(chuàng)業(yè)公司。我們致力于實(shí)現(xiàn)高質(zhì)量的國產(chǎn)化測(cè)試系統(tǒng)，力求通過仿真和測(cè)試來還原和驗(yàn)證電子物理世界的運(yùn)行邏輯和功能。我們堅(jiān)信，測(cè)試對(duì)于尖端電子系統(tǒng)的整個(gè)生命周期都意義非凡，特別是對(duì)于衛(wèi)星、汽車等有頂級(jí)可靠性需求的復(fù)雜對(duì)象。我們的創(chuàng)始團(tuán)隊(duì)來自于中科大、哈工大和上海交大，核心團(tuán)隊(duì)在電子測(cè)試測(cè)量、衛(wèi)星通信、汽車平臺(tái)等領(lǐng)域人均超過15年的科研、市場(chǎng)和管理經(jīng)驗(yàn)。依托哈爾濱工業(yè)大學(xué)在航天、通信等領(lǐng)域的技術(shù)專利和行業(yè)沉淀，我們擁有國內(nèi)一流的針對(duì)復(fù)雜電子系統(tǒng)測(cè)試的算法硬解能力和工程實(shí)現(xiàn)能力。關(guān)于招聘大儀誠邀您的加入。我們追求和塑造的是一種求真的工程師文化，我們?cè)趯ふ覔碛泄餐瑑r(jià)值觀，對(duì)于硬科技和航天、新能源等行業(yè)有熱情的伙伴。我們會(huì)提供有競(jìng)爭(zhēng)力的薪酬和福利計(jì)劃，并且會(huì)幫忙伙伴們?cè)诩夹g(shù)和學(xué)術(shù)上獲得持續(xù)深造的機(jī)會(huì)。
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