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更新于 4月23日

芯片版圖工程師

1.5-3萬·14薪
  • 深圳龍崗區(qū)
  • 3-5年
  • 本科
  • 全職
  • 招2人

職位描述

Top版圖設(shè)計IP版圖設(shè)計版圖布局規(guī)劃CMOS工藝Cadence Allegro電子/半導(dǎo)體/集成電路
職位介紹 職責(zé)描述: 1. 負(fù)責(zé)各類高速高精度模擬IP版圖設(shè)計驗證工作; 2. 負(fù)責(zé)模塊和芯片級版圖floor-plan設(shè)計驗證工作; 3. 負(fù)責(zé)芯片級產(chǎn)品后端PV驗證及TO流程; 4. 負(fù)責(zé)模塊版圖和芯片級版圖的可靠性設(shè)計和驗證工作; 5. 負(fù)責(zé)版圖設(shè)計、驗證環(huán)境搭建和流程優(yōu)化、負(fù)責(zé)撰寫技術(shù)文檔及設(shè)計報告; 任職要求: 1. 本科及以上學(xué)歷,微電子、集成電路、物理類、電子工程類相關(guān)專業(yè); 2. 3年以上模擬版圖設(shè)計工作經(jīng)驗; 3. 熟悉半導(dǎo)體制造工藝,了解器件物理結(jié)構(gòu),了解半導(dǎo)體器件特性; 4. 具有扎實的模擬IP版圖設(shè)計經(jīng)驗;具有BGR、OPA、DAC、ADC、OSC、PLL、CDR、PI等模擬IP版圖設(shè)計經(jīng)驗,具有高速模擬IP版圖設(shè)計經(jīng)驗優(yōu)先; 5. 有芯片級版圖整合和驗證經(jīng)驗優(yōu)先,有可靠性驗證包括ESD、 Latch-up、EOS等經(jīng)驗優(yōu)先; 5. 熟練使用EDA工具;有一定的rule編寫能力優(yōu)先; 6. 有一定的腳本編寫能力,Skill、 Perl、 Tcl、 Shell等語言; 7. 具有較強(qiáng)的自主學(xué)習(xí)能力、分析問題能力、溝通能力、較好的團(tuán)隊合作意識和奮斗精神。 崗位地點(diǎn):深圳/上海

工作地點(diǎn)

深圳龍崗區(qū)中科谷

職位發(fā)布者

楊悅/HR

三日內(nèi)活躍
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深圳市新凱來技術(shù)有限公司
深圳市新凱來技術(shù)有限公司是一家半導(dǎo)體零部件和高端工業(yè)裝備研發(fā)、制造、銷售、服務(wù)的高科技公司,致力于打造國內(nèi)電子信息產(chǎn)業(yè)的可靠基礎(chǔ),成立于2021年8月,是深圳國資委全資子公司,與國內(nèi)知名半導(dǎo)體廠商均有戰(zhàn)略合作關(guān)系。
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