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更新于 5月20日
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舉報(bào)

算法工程師

1-1.5萬(wàn)

職位描述

C語(yǔ)言電子/半導(dǎo)體/集成電路
崗位職責(zé)：
1、負(fù)責(zé)項(xiàng)目的系統(tǒng)劃分、FPGA系統(tǒng)設(shè)計(jì)與開(kāi)發(fā)；
2、配合IC設(shè)計(jì)工程師設(shè)計(jì)相應(yīng)的功能模塊，設(shè)計(jì)基于FPGA邏輯驗(yàn)證和功能開(kāi)發(fā)； 3、配合IC設(shè)計(jì)工程師進(jìn)行算法驗(yàn)證以及FPGA實(shí)現(xiàn)； 4、同算法、硬件、軟件設(shè)計(jì)人員一起完成相關(guān)方面項(xiàng)目規(guī)劃以及聯(lián)調(diào)； 5、負(fù)責(zé)項(xiàng)目和產(chǎn)品相關(guān)文檔的編寫工作； 6、領(lǐng)導(dǎo)安排的其他相關(guān)工作。
任職要求：
1、電子信息工程、軟件工程、計(jì)算機(jī)、自動(dòng)化類等相關(guān)專業(yè); 2、熟練掌握Verilog或VHDL硬件描述語(yǔ)言； 3、熟練運(yùn)用ISE、modelsim、vivado等FPGA開(kāi)發(fā)工具； 4、熟練掌握V7、Ultrascale、ZYNQ等FPGA開(kāi)發(fā)； 5、精通SPI、I2C、UART、CAN等基礎(chǔ)通信協(xié)議，熟悉其他各種通信協(xié)議，熟悉LVDS、SDRAM、FLASH、DDR、PCIE、SRIO、以太網(wǎng)等接口工作原理； 6、熟悉SerDes、Rapidio、DDR3/4、PCIE、JESD204B等高速接口工作原理并完成邏輯編碼；
7、具有較強(qiáng)的學(xué)習(xí)能力、溝通能力和協(xié)作能力，喜歡鉆研，具備創(chuàng)新能力和拼搏精神。

工作地點(diǎn)

無(wú)錫錫山區(qū)錫山經(jīng)濟(jì)技術(shù)開(kāi)發(fā)區(qū)二泉東路19號(hào)

職位發(fā)布者

王女士/HRBP

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本公司由中科芯集成電路有限公司（無(wú)錫）、中國(guó)電科集團(tuán)（北京）投資基金、員工骨干等多方參股的專業(yè)集成電路設(shè)計(jì)公司，公司地址位于風(fēng)景秀麗、集成電路產(chǎn)業(yè)鏈發(fā)達(dá)的無(wú)錫市區(qū)。公司獲得國(guó)家高新技術(shù)企業(yè)、國(guó)家級(jí)專精特新“小巨人”企業(yè)等榮譽(yù)，歡迎廣大有志于集成電路、電子線路軟硬件技術(shù)、微電子技術(shù)人才的加盟，同創(chuàng)輝煌，共同進(jìn)步！
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