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【崗位職責(zé)】 1、負(fù)責(zé)雷達(dá)電子對(duì)抗系統(tǒng)中信號(hào)處理算法的設(shè)計(jì)與開發(fā)，包括但不限于： o 雷達(dá)對(duì)抗偵察（信號(hào)檢測、參數(shù)估計(jì)、調(diào)制識(shí)別） o 干擾技術(shù)（噪聲干擾、欺騙干擾、智能干擾波形生成） o 高精度測向算法（DBF、MUSIC、ESPRIT等） o 雷達(dá)信號(hào)分選與識(shí)別（PRI分析、時(shí)頻分析、機(jī)器學(xué)習(xí)分選） 2、完成算法的數(shù)學(xué)建模、仿真驗(yàn)證及性能優(yōu)化，參與系統(tǒng)級(jí)指標(biāo)論證與方案設(shè)計(jì)。 3、完成算法在FPGA/DSP平臺(tái)的工程實(shí)現(xiàn)（Verilog/VHDL、C/C++），解決實(shí)時(shí)性、資源優(yōu)化等關(guān)鍵問題。 4、跟蹤前沿技術(shù)動(dòng)態(tài)，參與智能化認(rèn)知電子戰(zhàn)等新技術(shù)預(yù)研。 【任職要求】 1、學(xué)歷要求：碩士及以上學(xué)歷，電子工程、信號(hào)與信息處理、通信工程、雷達(dá)工程等相關(guān)專業(yè)； 2、技術(shù)能力： o 精通雷達(dá)信號(hào)處理理論基礎(chǔ)，熟悉雷達(dá)對(duì)抗偵察/干擾/測向/分選核心算法。 o 具備FPGA或DSP開發(fā)經(jīng)驗(yàn)，能獨(dú)立完成算法工程實(shí)現(xiàn)與優(yōu)化。 o 熟悉電子對(duì)抗系統(tǒng)指標(biāo)（靈敏度、動(dòng)態(tài)范圍、ERP等）的論證方法。 3、優(yōu)先條件： o 有實(shí)際雷達(dá)電子對(duì)抗項(xiàng)目經(jīng)驗(yàn)者優(yōu)先。 o 熟悉深度學(xué)習(xí)/機(jī)器學(xué)習(xí)在電子對(duì)抗領(lǐng)域的應(yīng)用。 4、其他要求： 具備較強(qiáng)的英文文獻(xiàn)閱讀能力，良好的團(tuán)隊(duì)協(xié)作與溝通能力。