職位描述
SynopsysVCSVerdiPerlPythonShellPCIE模塊級(jí)驗(yàn)證子系統(tǒng)級(jí)驗(yàn)證FPGA芯片船舶/航空/航天/火車(chē)制造
職位職責(zé)：
負(fù)責(zé)FPGA/ASIC邏輯設(shè)計(jì)驗(yàn)證，包括：
從需求/場(chǎng)景/功能/性能/接口等維度設(shè)計(jì)測(cè)試點(diǎn)
制定驗(yàn)證方案及測(cè)試向量
完成白盒/專(zhuān)項(xiàng)驗(yàn)證
核心要求：
2. 精通Verilog/SystemVerilog及UVM驗(yàn)證方法學(xué)
3. 熟悉Synopsys驗(yàn)證工具鏈（VCS/Verdi/DVE優(yōu)先）
4. 掌握至少一種腳本語(yǔ)言（Perl/Python/Shell/Makefile）
加分項(xiàng)：
5. 具有PCIe/Ethernet協(xié)議驗(yàn)證經(jīng)驗(yàn)
6. 具備適航協(xié)議驗(yàn)證經(jīng)驗(yàn)
7. 熟悉Synopsys VIP驗(yàn)證
8. 掌握形式驗(yàn)證及Lint規(guī)范檢查職位職責(zé)：
負(fù)責(zé)FPGA/ASIC邏輯設(shè)計(jì)驗(yàn)證，包括：
從需求/場(chǎng)景/功能/性能/接口等維度設(shè)計(jì)測(cè)試點(diǎn)
制定驗(yàn)證方案及測(cè)試向量
完成白盒/專(zhuān)項(xiàng)驗(yàn)證
核心要求：
2. 精通Verilog/SystemVerilog及UVM驗(yàn)證方法學(xué)
3. 熟悉Synopsys驗(yàn)證工具鏈（VCS/Verdi/DVE優(yōu)先）
4. 掌握至少一種腳本語(yǔ)言（Perl/Python/Shell/Makefile）
加分項(xiàng)：
5. 具有PCIe/Ethernet協(xié)議驗(yàn)證經(jīng)驗(yàn)
6. 具備適航協(xié)議驗(yàn)證經(jīng)驗(yàn)
7. 熟悉Synopsys VIP驗(yàn)證
8. 掌握形式驗(yàn)證及Lint規(guī)范檢查
工作地點(diǎn)
江蘇省蘇州市吳中區(qū)長(zhǎng)虹北路168甪直鎮(zhèn)長(zhǎng)虹北路169號(hào)吳淞江商務(wù)區(qū)A幢2層
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職位發(fā)布者
胡小剛/人事經(jīng)理
昨日活躍立即溝通
中科億海微電子科技(蘇州)有限公司中科億海微電子科技（蘇州）有限公司，是“可編程芯片與微系統(tǒng)”研究領(lǐng)域的科研與產(chǎn)業(yè)化團(tuán)隊(duì)，按照國(guó)家創(chuàng)新驅(qū)動(dòng)發(fā)展戰(zhàn)略，發(fā)起成立的以“可編程邏輯IP核與EDA工具”為技術(shù)特色，以FPGA、自適應(yīng)SoC、可重構(gòu)計(jì)算系統(tǒng)的設(shè)計(jì)與集成為主營(yíng)業(yè)務(wù)的高新技術(shù)企業(yè)，公司于2017年1月在蘇州注冊(cè)成立。公司堅(jiān)持全正向設(shè)計(jì)技術(shù)路線，自主研制具有高可靠性的嵌入式可編程電路IP核、可編程邏輯芯片、EDA軟件與可重構(gòu)系統(tǒng)，提供具有高性能和自適應(yīng)計(jì)算的行業(yè)解決方案和集成電路設(shè)計(jì)服務(wù)，滿足智能制造、現(xiàn)代通信、能源電力、軌道交通、汽車(chē)電子、廣電傳媒、地質(zhì)勘探、金融科技、電子政務(wù)、醫(yī)療器械、測(cè)試測(cè)量等業(yè)務(wù)領(lǐng)域的應(yīng)用需要。公司現(xiàn)有員工三百多人，其中博士和碩士占比35%，專(zhuān)業(yè)技術(shù)研發(fā)人員占比45%，涵蓋集成電路硬件設(shè)計(jì)、軟件設(shè)計(jì)、測(cè)試、抗輻照加固、可靠性保障、產(chǎn)品應(yīng)用推廣等方面。公司同時(shí)承擔(dān)研究生培養(yǎng)職能，現(xiàn)有研究生導(dǎo)師多名，培養(yǎng)微電子學(xué)與固體電子學(xué)、集成電路工程專(zhuān)業(yè)博士、碩士研究生近20人，已與多所高校開(kāi)展了產(chǎn)學(xué)研合作。
公司主頁(yè)