職位描述
Verilog HDLVHDLSystem Verilog
FPGA任職要求：
1、負責FPGA邏輯方案設(shè)計和代碼編寫；
2、負責FPGA仿真驗證和系統(tǒng)聯(lián)調(diào)；
3、支持項目現(xiàn)場調(diào)試及客戶問題解決。
任職資格
1、通信.電子.計算機等相關(guān)專業(yè)，本科及以上學歷； 2、3年以上FPGA開發(fā)經(jīng)驗，精通verilog語言，熟悉FPGA開發(fā)流程；
3、熟悉以太網(wǎng)IPV6協(xié)議ICMPV6、UDP、DDR通信協(xié)議；
4、能自我驅(qū)動，具備良好的學習意識及學習習慣； 5、有較強的團隊合作精神、溝通能力和敬業(yè)精神。 6.熟悉SM3.SM4算法。
1、負責FPGA邏輯方案設(shè)計和代碼編寫；
2、負責FPGA仿真驗證和系統(tǒng)聯(lián)調(diào)；
3、支持項目現(xiàn)場調(diào)試及客戶問題解決。
任職資格
1、通信.電子.計算機等相關(guān)專業(yè)，本科及以上學歷； 2、3年以上FPGA開發(fā)經(jīng)驗，精通verilog語言，熟悉FPGA開發(fā)流程；
3、熟悉以太網(wǎng)IPV6協(xié)議ICMPV6、UDP、DDR通信協(xié)議；
4、能自我驅(qū)動，具備良好的學習意識及學習習慣； 5、有較強的團隊合作精神、溝通能力和敬業(yè)精神。 6.熟悉SM3.SM4算法。
工作地點
西安市-雁塔區(qū)-科技路附近3205-3
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職位發(fā)布者
梁先生/技術(shù)總監(jiān)
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杭州柏煜星安科技有限公司，深耕星載安全組件領(lǐng)域，以硬核加密加解密技術(shù)為核心，為衛(wèi)星全生命周期構(gòu)筑天地一體化的可信安全底座。我們聚焦衛(wèi)星通信、導(dǎo)航、遙感等全業(yè)務(wù)鏈路的安全需求，打造高可靠、抗輻射、輕量化的星載安全設(shè)備，實現(xiàn)衛(wèi)星數(shù)據(jù)的加密存儲、端到端保密傳輸與指令可信驗證，以專業(yè)技術(shù)守護太空信息安全，助力商業(yè)航天與航天工程的安全發(fā)展，讓衛(wèi)星設(shè)備在浩瀚星空擁有堅不可摧的安全屏障。
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