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**成都入職簽約后派駐北京項(xiàng)目技術(shù)支持（預(yù)計(jì)項(xiàng)目周期一年左右）** 一、崗位職責(zé) 1、負(fù)責(zé) FPGA 系統(tǒng)的設(shè)計(jì)、開發(fā)與調(diào)試，依據(jù)項(xiàng)目需求完成邏輯設(shè)計(jì)、代碼編寫及功能仿真等工作。 2、參與機(jī)載設(shè)備中 FPGA 相關(guān)模塊的方案制定，協(xié)同硬件工程師完成硬件接口設(shè)計(jì)與調(diào)試，確保系統(tǒng)硬件與 FPGA 軟件的良好適配。 3、對(duì)現(xiàn)有 FPGA 程序進(jìn)行優(yōu)化與維護(hù)，提升系統(tǒng)性能，解決運(yùn)行過(guò)程中出現(xiàn)的技術(shù)問(wèn)題。 4、編寫詳細(xì)的設(shè)計(jì)文檔，包括設(shè)計(jì)方案、代碼注釋、測(cè)試報(bào)告等，保障項(xiàng)目開發(fā)過(guò)程的規(guī)范性與可追溯性。 二、任職要求 1、本科及以上學(xué)歷，電子信息、通信工程、自動(dòng)化等相關(guān)專業(yè)，具有3年以上 FPGA 開發(fā)經(jīng)驗(yàn)優(yōu)先。 2、精通 Verilog 或 VHDL 硬件描述語(yǔ)言，能夠獨(dú)立完成復(fù)雜 FPGA 邏輯設(shè)計(jì)與代碼實(shí)現(xiàn)。 3、熟悉常見的 FPGA 開發(fā)工具，如 Xilinx ISE、Vivado，Altera Quartus Prime 等，掌握 FPGA 設(shè)計(jì)流程與調(diào)試方法。 4、具備良好的數(shù)字電路基礎(chǔ)，熟悉時(shí)序分析、同步電路設(shè)計(jì)、異步電路處理等知識(shí)，能夠熟練閱讀和分析硬件原理圖。 5、有機(jī)載設(shè)備開發(fā)經(jīng)驗(yàn)者優(yōu)先考慮，熟悉機(jī)載電子系統(tǒng)架構(gòu)、航空總線協(xié)議（如 ARINC429、ARINC664 等），了解航空電子設(shè)備相關(guān)標(biāo)準(zhǔn)與規(guī)范（如 DO-178B、DO-254 等）。 6、具備較強(qiáng)的問(wèn)題解決能力和學(xué)習(xí)能力，能夠在壓力環(huán)境下高效工作，良好的團(tuán)隊(duì)協(xié)作精神，溝通表達(dá)能力佳。