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更新于 9月9日

邏輯設計工程師(FPGA)

2-2.3萬
  • 成都郫都區(qū)
  • 3-5年
  • 本科
  • 全職
  • 招1人

職位描述

C語言Verilog HDL
崗位職責:
1、精通Altera、Xilinx等公司主流FPGA器件及開發(fā)環(huán)境進行項目開發(fā);
2、負責產(chǎn)品研發(fā)中FPGA選型、方案架構設計與論證、功能模塊以及接口部分設計,編寫相關設計開發(fā)文檔;
3、負責各功能模塊的邏輯實現(xiàn)、仿真、時序約束與分析、RTL代碼的邏輯綜合、調(diào)試、測試以及與軟件、硬件設計人員聯(lián)調(diào);
崗位要求:
1、精通Verilog HDL等硬件編程語言;熟悉C語言編程;精通掌握Altera/Xilinx等FPGA相關工具和開發(fā)流程;
2、具備硬件設計能力,有軟硬件協(xié)同設計經(jīng)驗;熟悉模擬電路和高速數(shù)字電路相關設計(FPGA、ARM、單片機、高速ADC/DAC、PCIE、DDR)。熟悉AD9361/AD9364等;能夠熟練使用cadence進行原理圖、PCB設計;
3、具有較好的信號處理理論知識,對功耗、面積等指標保持敏感,編碼結構清晰且對質(zhì)量有較高追求
4、能夠跨越傳統(tǒng)軟硬件界限,獨立快速驗證所設計模塊或功能
5、有高質(zhì)量項目成果、構建AI加速子系統(tǒng)者優(yōu)先?

工作地點

郫都區(qū)成都大公博創(chuàng)信息技術有限公司

職位發(fā)布者

馮正/人事經(jīng)理

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