職位描述
Verilog HDLVHDLModelsimVivadoISEQUARTUSIIHDL DESIGNERVINCENT船舶/航空/航天/火車(chē)制造
FPGA崗位職責(zé)：
1、具有1年以上軍G、軍品、武器類(lèi)FPGA測(cè)試經(jīng)驗(yàn)；
2、熟練使用HDL designer、vincent、Modelsim等測(cè)試工具；
3、熟練掌握第三方測(cè)試流程，具備獨(dú)立完成GJB 9433測(cè)試要求的能力（代碼審查、邏輯測(cè)試、時(shí)序測(cè)試、動(dòng)態(tài)測(cè)試含仿真等）；
4、熟練掌握VHDL、Verilog硬件描述語(yǔ)言，具備代碼走查能力；
5、能依據(jù)需求編寫(xiě)測(cè)評(píng)大綱、提取測(cè)試用例，并進(jìn)行測(cè)試總結(jié)，撰寫(xiě)測(cè)評(píng)報(bào)告等文檔；
6、熟練使用Vivado、ISE、QuartusII等開(kāi)發(fā)工具；
7、具備研究所工作經(jīng)驗(yàn)者優(yōu)先，溝通能力強(qiáng)且有較強(qiáng)解決問(wèn)題能力者優(yōu)先。
崗位要求：
1、大專(zhuān)以上學(xué)歷；
2、晚上和周六需要加班，有加班費(fèi)；
3、若需要出差，有差補(bǔ)。
1、具有1年以上軍G、軍品、武器類(lèi)FPGA測(cè)試經(jīng)驗(yàn)；
2、熟練使用HDL designer、vincent、Modelsim等測(cè)試工具；
3、熟練掌握第三方測(cè)試流程，具備獨(dú)立完成GJB 9433測(cè)試要求的能力（代碼審查、邏輯測(cè)試、時(shí)序測(cè)試、動(dòng)態(tài)測(cè)試含仿真等）；
4、熟練掌握VHDL、Verilog硬件描述語(yǔ)言，具備代碼走查能力；
5、能依據(jù)需求編寫(xiě)測(cè)評(píng)大綱、提取測(cè)試用例，并進(jìn)行測(cè)試總結(jié)，撰寫(xiě)測(cè)評(píng)報(bào)告等文檔；
6、熟練使用Vivado、ISE、QuartusII等開(kāi)發(fā)工具；
7、具備研究所工作經(jīng)驗(yàn)者優(yōu)先，溝通能力強(qiáng)且有較強(qiáng)解決問(wèn)題能力者優(yōu)先。
崗位要求：
1、大專(zhuān)以上學(xué)歷；
2、晚上和周六需要加班，有加班費(fèi)；
3、若需要出差，有差補(bǔ)。
工作地點(diǎn)
無(wú)錫新吳區(qū)寧韻路
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付女士/HRBP
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