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職位描述： 1) 具有良好的電路基礎(chǔ)，能夠讀懂電路圖； 2) 熟悉C、Verilog/VHDL、Tcl等語言； 3) 具有良好的發(fā)現(xiàn)問題和解決問題的能力，具有良好的文檔書寫能力； 4) 具有良好的溝通能力，團(tuán)隊(duì)協(xié)作能力，對(duì)待事情認(rèn)真負(fù)責(zé)專注； 5) 本科及以上學(xué)歷，集成電路/電子/通訊/計(jì)算機(jī)/自動(dòng)化控制相關(guān)專業(yè)，具有FPGA開發(fā)或C語言開發(fā)經(jīng)驗(yàn)優(yōu)先； 6) 深入理解基于FPGA、嵌入式技術(shù)產(chǎn)品生命周期及開發(fā)流程，熟練掌握C、VHDL/Verilog HDL語言的RTL編碼、邏輯綜合和靜態(tài)時(shí)序分析等技能； 7) 深入了解FPGA器件資源及使用方法； 8) 了解常用通信等協(xié)議以及校驗(yàn)算法； 9) 具有產(chǎn)品開發(fā)經(jīng)驗(yàn)者優(yōu)先； 10）有一定開發(fā)經(jīng)驗(yàn)或軍用第三方軟件測(cè)試中心工作經(jīng)驗(yàn)優(yōu)先。 任職要求： 1) 使用仿真驗(yàn)證工具進(jìn)行嵌入式和FPGA軟件驗(yàn)證； 2) 進(jìn)行FPGA軟件靜態(tài)時(shí)序分析、規(guī)則檢查、邏輯等效驗(yàn)證； 3) 協(xié)助制定測(cè)試計(jì)劃，編寫測(cè)試激勵(lì)、生成測(cè)試數(shù)據(jù)、編寫完成測(cè)試工作的相關(guān)文檔； 4) 搭建測(cè)試環(huán)境，編寫測(cè)試用例并執(zhí)行測(cè)試用例，提交測(cè)試報(bào)告； 5) 跟蹤bug狀態(tài)，執(zhí)行回歸測(cè)試。