職位描述
Verilog HDL電子/半導(dǎo)體/集成電路
【崗位定位】
專(zhuān)注于單板FPGA程序邏輯功能的正確性、時(shí)序和板級(jí)驗(yàn)證。
【核心職責(zé)】
1.參與制定FPGA驗(yàn)證策略，搭建仿真和板級(jí)測(cè)試環(huán)境。
2.編寫(xiě)和運(yùn)行測(cè)試用例，進(jìn)行功能仿真和時(shí)序分析。
3.協(xié)助硬件工程師進(jìn)行調(diào)試和故障定位。
4.學(xué)習(xí)并使用不同的FPGA測(cè)試軟件
【我們期待您】
了解FPGA開(kāi)發(fā)流程和數(shù)字電路設(shè)計(jì)，熟悉VHDL/Verilog語(yǔ)言。
有使用仿真工具（如ModelSim, VCS）的經(jīng)驗(yàn)者優(yōu)先。
邏輯清晰，具備較強(qiáng)的分析和解決問(wèn)題的能力。
專(zhuān)注于單板FPGA程序邏輯功能的正確性、時(shí)序和板級(jí)驗(yàn)證。
【核心職責(zé)】
1.參與制定FPGA驗(yàn)證策略，搭建仿真和板級(jí)測(cè)試環(huán)境。
2.編寫(xiě)和運(yùn)行測(cè)試用例，進(jìn)行功能仿真和時(shí)序分析。
3.協(xié)助硬件工程師進(jìn)行調(diào)試和故障定位。
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有使用仿真工具（如ModelSim, VCS）的經(jīng)驗(yàn)者優(yōu)先。
邏輯清晰，具備較強(qiáng)的分析和解決問(wèn)題的能力。
工作地點(diǎn)
北京市海淀區(qū)大柳樹(shù)路2號(hào)院(西區(qū))附近
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