職位描述
Verilog HDL電子/半導(dǎo)體/集成電路通信/網(wǎng)絡(luò)設(shè)備儀器儀表制造
崗位職責(zé)：
1、負(fù)責(zé)核心模塊及功能FPGA代碼編寫，仿真與調(diào)試；
2、負(fù)責(zé)FPGA系統(tǒng)工程搭建與開發(fā)；
3、與芯片設(shè)計(jì)工程師和硬件工程師完成FPGA硬件平臺(tái)的開發(fā)與調(diào)試；
4、與軟件和硬件工程師配合完成系統(tǒng)功能調(diào)試。
任職要求：
1、統(tǒng)招本科以上學(xué)歷，電子、通信、自動(dòng)化等相關(guān)專業(yè)；
2、3年以上FPGA開發(fā)經(jīng)驗(yàn)，有高速接口開發(fā)經(jīng)驗(yàn)，有芯片行業(yè)經(jīng)驗(yàn)優(yōu)先；
3、熟練使用Verilog編碼，熟悉Xilinx FPGA器件；
4、有良好的編碼及文檔撰寫習(xí)慣及較強(qiáng)的版本管理意識(shí)；
5、自我激勵(lì)、積極主動(dòng)，以結(jié)果為導(dǎo)向，學(xué)習(xí)意愿強(qiáng)；
6、具備較強(qiáng)的執(zhí)行力和時(shí)間管理能力；
7、善于溝通，具有良好的團(tuán)隊(duì)合作精神。
公司提供：具備競(jìng)爭(zhēng)力的薪酬；股權(quán)激勵(lì)；全面的福利保障；務(wù)實(shí)平等的工作環(huán)境；與行業(yè)內(nèi)頂尖設(shè)計(jì)、應(yīng)用和市場(chǎng)團(tuán)隊(duì)一起共事并成長(zhǎng)。
工作地點(diǎn)
北京海淀區(qū)學(xué)清嘉創(chuàng)大廈A座9層
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