職位描述
VerilogVHDLVivado
崗位職責(zé)：通信調(diào)制解調(diào)軟件開發(fā)
1. 負(fù)責(zé)FPGA軟件的RTL代碼編寫、仿真；
2. 負(fù)責(zé)FPGA軟件的需求分析、軟件設(shè)計等文檔撰寫；
3. 負(fù)責(zé)FPGA軟件及產(chǎn)片的綜合和測試工作。
任職條件：
1. 電子信息技術(shù)、通信工程、光信息、計算機(jī)等相關(guān)專業(yè)；
2. 至少3年以上FPGA設(shè)計相關(guān)工作經(jīng)驗；
工作地點(diǎn)
上海育成生物科技園上海市嘉定區(qū)興賢路1180號4號樓
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