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更新于 9月18日
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高級芯片設計工程師-集成電路學院(J10294)

1.2-1.6萬
  • 杭州蕭山區(qū)
  • 3-5年
  • 本科
  • 全職
  • 招1人

職位描述

傳感器芯片
崗位職責:
崗位職責：
?和浙大、浙大科創(chuàng)中心科研與開發(fā)團隊合作，圍繞下一代無線通信技術(shù)的算法IP 核實現(xiàn)芯片微架構(gòu)設計、開發(fā)、驗證、FPGA 實現(xiàn)和文檔編制
?使用 SystemVerilog 開發(fā)算法IP 核的 RTL 實現(xiàn)
?使用 SystemVerilog和 DPI 為無線通信系統(tǒng)的 RTL 實現(xiàn)開發(fā)測試平臺(testbench)
?充分發(fā)揮RTL 設計、實現(xiàn)和驗證方面的技能，承擔項目責任，主導項目開發(fā)，為項目的成功和及時交付做出貢獻
?積極參與并遵守團隊的工程開發(fā)流程、方法、設計技術(shù)，并提出改進建議，以提高設計和產(chǎn)品質(zhì)量的效率和質(zhì)量
任職要求:
任職要求：
?本科及以上學歷，專業(yè)不限
?具有3年或以上數(shù)字芯片設計的工作經(jīng)驗
?掌握 RTL 語言（如SystemVerilog 、Verilog 、VHDL）
?掌握 STA 和 EDA 工具以及數(shù)字設計優(yōu)化，以滿足 ASIC 或FPGA 的時序約束要求
?掌握腳本語言（如 Bash、Perl、Python、TCL）
?具有交付ASIC 或 FPGA的數(shù)字設計系統(tǒng)或子系統(tǒng)的經(jīng)驗
?具有針對高吞吐量的數(shù)據(jù)或信號處理應用的時序和硬件資源優(yōu)化的經(jīng)驗
?具有使用仿真和綜合的相關 EDA 工具的經(jīng)驗（如 QuestaSim、Synopsys VCS 、Synopsys Verdi、Intel Quartus、Xilinx Vivado、Synopsys DC Ultra 或 NXT、Cadence Genus）
?可熟練閱讀英文專業(yè)資料，編寫技術(shù)文檔、設計規(guī)范、用戶指南、驗證計劃
?具有團隊合作精神
?具有良好的書面、演示和口頭表達能力
加分項（非必要）
?熟悉無線通信信號處理算法（如信道均衡、信道估計、信道編碼、波束賦形或其他基帶模塊）
?具有使用 SystemC 設計建模和集成的經(jīng)驗
?具有Lint check的經(jīng)驗，和/或邏輯等價檢查LEC的經(jīng)驗（如Formality/Conformal），和/或DFT設計的經(jīng)驗
?了解 Git、Perforce 等版本控制工具，掌握高級版本控制技術(shù)
?了解 AXI 接口（如AXI MM、AXI Lite 和 AXI Streaming），并了解這些接口的 RTL 實現(xiàn)
?了解移動通信系統(tǒng)
?了解電信和/或半導體行業(yè)

工作地點

蕭山區(qū)浙江大學杭州國際科創(chuàng)中心水博園區(qū)

職位發(fā)布者

施女士/hr

三日內(nèi)活躍
立即溝通
公司Logo浙江大學杭州國際科創(chuàng)中心
浙江大學杭州國際科創(chuàng)中心(以下簡稱杭州科創(chuàng)中心)是由浙江大學注冊舉辦的事業(yè)單位，是新時代杭州市與浙江大學深化全面戰(zhàn)略合作的重要項目。杭州科創(chuàng)中心面向國家重大戰(zhàn)略和區(qū)域經(jīng)濟社會發(fā)展需求，聚焦前沿科學研究、顛覆性技術(shù)研發(fā)、成果轉(zhuǎn)化與產(chǎn)業(yè)化三大主體功能，推動基礎研究與應用研究、科技創(chuàng)新與產(chǎn)業(yè)發(fā)展的雙向聯(lián)動，打造長三角一體化高質(zhì)量發(fā)展的重要創(chuàng)新極和杰出人才匯聚地，建設具有世界一流水平、引領未來發(fā)展的全球頂尖科技創(chuàng)新中心。
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