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更新于 1月27日

高級fpga工程師

2.5-4萬·13薪
  • 深圳龍華區(qū)
  • 5-10年
  • 本科
  • 全職
  • 招1人

職位描述

Verilog HDLC語言C++計(jì)算機(jī)硬件電子設(shè)備制造電子/半導(dǎo)體/集成電路
崗位職責(zé)
1. 根據(jù)系統(tǒng)需求,參與FPGA器件選型、方案設(shè)計(jì),負(fù)責(zé)邏輯設(shè)計(jì)、仿真和調(diào)試;
2. 編寫系統(tǒng)設(shè)計(jì)文檔、測試文檔與使用文檔等;
3. 配合軟、硬件工程師完成設(shè)計(jì)任務(wù)和系統(tǒng)測試;
4. 分析典型問題并輸出案例分析文件;
5. 分析競品并輸出技術(shù)點(diǎn)總結(jié)文件;
崗位要求
1. 電子、通信、計(jì)算機(jī)、自動化等專業(yè)本科及以上學(xué)歷;5年以上FPGA設(shè)計(jì)工作經(jīng)驗(yàn);
2. 精通數(shù)字邏輯系統(tǒng)設(shè)計(jì),精通Verilog語言,熟練掌握邏輯設(shè)計(jì)、仿真、時(shí)序優(yōu)化和調(diào)試;
3. 熟悉Altera、Microsemi,xilinx,lattic系列FPGA器件,熟練使用相關(guān)的開發(fā)工具;
4. 熟練使用實(shí)驗(yàn)室常用儀器,具備豐富的電路知識和系統(tǒng)調(diào)試能力;
5. 熟悉圖像處理算法;
6. 具有良好的理解能力及英語閱讀能力;
8. 具備良好的溝通能力和團(tuán)隊(duì)合作意識,誠實(shí)守信,刻苦鉆研,能夠積極主動地完成相關(guān)工作;

工作地點(diǎn)

深圳龍華區(qū)麗榮路1號國樂科技園3棟西側(cè)302

職位發(fā)布者

馮玉林/總經(jīng)理

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深圳銳灃科技有限公司成立于 2018年,是國家高新技術(shù)企業(yè),榮獲深圳市專精特興稱號,公司主要從事牙模3D打印自動化生產(chǎn)線研發(fā)及銷售工作,核心團(tuán)隊(duì)成員由多名在制造業(yè)工作多年的博士組成,公司提倡勤奮、創(chuàng)新、開放、交流,學(xué)習(xí)氛圍濃厚,制備業(yè)就是苦逼的活,唯有腳踏實(shí)地才能真正的做好制備業(yè),公司管理團(tuán)隊(duì)目光長遠(yuǎn),注重技術(shù)的長期積累。深圳銳灃真誠地歡迎懷有共同價(jià)值觀的朋友加盟公司,與公司共同成長發(fā)展。
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