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1、負(fù)責(zé)智能網(wǎng)卡芯片的驗(yàn)證工作，包括模塊級(jí)（Block）、子系統(tǒng)級(jí)（Subsystem）和全芯片級(jí)（Top-Level）驗(yàn)證，確保功能正確性和性能達(dá)標(biāo)。
2、搭建和維護(hù)基于UVM的驗(yàn)證平臺(tái)，開(kāi)發(fā)測(cè)試用例、激勵(lì)生成、檢查機(jī)制（Scoreboard/Monitor）和覆蓋率模型。
3、協(xié)助驗(yàn)證經(jīng)理制定驗(yàn)證策略和方案，完成功能覆蓋率（Functional Coverage）和代碼覆蓋率（Code Coverage）分析，確保驗(yàn)證完備性。
4、優(yōu)化仿真流程，使用VCS/Verdi等EDA工具進(jìn)行調(diào)試，提升驗(yàn)證效率。
任職要求：
1、本科及以上學(xué)歷，計(jì)算機(jī)、電子、通信及相關(guān)專(zhuān)業(yè)畢業(yè)。
2、5年以上數(shù)字電路驗(yàn)證經(jīng)驗(yàn)，有主持或參與大型ASIC或FPGA驗(yàn)證項(xiàng)目經(jīng)歷，承擔(dān)過(guò)大型芯片的Block級(jí)、Top級(jí)驗(yàn)證工作。
3、精通Verilog和System Verilog語(yǔ)言，精通UVM驗(yàn)證方法學(xué)，具有搭建驗(yàn)證平臺(tái)及編寫(xiě)驗(yàn)證組件的能力，能獨(dú)立完成芯片驗(yàn)證策略和驗(yàn)證方案。
4、熟悉Linux系統(tǒng)下的驗(yàn)證環(huán)境、流程，熟練掌握VCS、Verdi等驗(yàn)證相關(guān)工具。
5、具有相關(guān)腳本語(yǔ)言開(kāi)發(fā)經(jīng)驗(yàn)，熟練使用以下腳本至少其中一種：Shell、Makefile、Tcl、Perl、Python等。
6、具備以下經(jīng)驗(yàn)者優(yōu)先：
參與過(guò)網(wǎng)絡(luò)通信類(lèi)大型芯片項(xiàng)目開(kāi)發(fā)；
熟悉TCP/IP、RDMA等相關(guān)協(xié)議；
熟悉SVA斷言仿真或Formal驗(yàn)證方法；
參與過(guò)大型芯片的FPGA原型或Emulation驗(yàn)證工作；
熟悉SOC芯片的驗(yàn)證方法。