職位描述
C語言SV語言VCSUVM電子/半導(dǎo)體/集成電路
崗位內(nèi)容：
1. 為 SoC 的功能和性能驗證設(shè)計測試計劃，編寫測試用例和測試腳本。
2. 執(zhí)行驗證測試，并對測試結(jié)果進行詳細分析和總結(jié)。
3. 跟蹤設(shè)計問題和測試問題，并協(xié)作解決問題，持續(xù)優(yōu)化驗證流程。
4. 維護和更新驗證環(huán)境以及部分自動化工具。
任職要求：
1. 具備扎實的計算機體系結(jié)構(gòu)基礎(chǔ)知識，對計算機組成原理有深入理解。
2. 熟練掌握 Verilog/VHDL 語言，能夠理解 RTL 和門級電路原理圖。
3. 熟悉常見的仿真工具和驗證方法，如 VCS、Modelsim、UVM 等。
4. 能夠獨立分析問題并提出解決方案，善于團隊合作，具備良好的溝通能力。
1. 為 SoC 的功能和性能驗證設(shè)計測試計劃，編寫測試用例和測試腳本。
2. 執(zhí)行驗證測試，并對測試結(jié)果進行詳細分析和總結(jié)。
3. 跟蹤設(shè)計問題和測試問題，并協(xié)作解決問題，持續(xù)優(yōu)化驗證流程。
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任職要求：
1. 具備扎實的計算機體系結(jié)構(gòu)基礎(chǔ)知識，對計算機組成原理有深入理解。
2. 熟練掌握 Verilog/VHDL 語言，能夠理解 RTL 和門級電路原理圖。
3. 熟悉常見的仿真工具和驗證方法，如 VCS、Modelsim、UVM 等。
4. 能夠獨立分析問題并提出解決方案，善于團隊合作，具備良好的溝通能力。
工作地點
西安市-碑林區(qū)-通義巷
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