職位描述
Verilog HDL
崗位職責(zé)：
1. 根據(jù)項(xiàng)目的功能需求及任務(wù)安排，編寫邏輯方案設(shè)計(jì)、模塊劃分；
2. 功能實(shí)現(xiàn)的詳細(xì)代碼，仿真實(shí)現(xiàn)，測試用例，邏輯使用說明文檔的編寫；
3. 協(xié)助硬件工程師確定器件選型、對FPGA等芯片的設(shè)計(jì)進(jìn)行討論指導(dǎo)、審查；
4. 項(xiàng)目聯(lián)調(diào)，配合軟件、硬件工程師進(jìn)行各個(gè)接口的調(diào)試，以及與客戶的聯(lián)調(diào)。
崗位要求
1. 碩士及以上學(xué)歷，碩士及以上學(xué)歷，計(jì)算機(jī)類、電子信息類、電氣類、控制類、自動(dòng)化類、儀器儀表等相關(guān)專業(yè)；
2.熟悉Verilog/VHDL語言；熟悉FPGA的高速接口開發(fā)，包括PCIe、DDR、ADC、DAC、GTX、SRIO等優(yōu)先；
4.具有良好的學(xué)習(xí)能力、溝通能力、文檔書寫能力及上進(jìn)心和自律性。
1. 根據(jù)項(xiàng)目的功能需求及任務(wù)安排，編寫邏輯方案設(shè)計(jì)、模塊劃分；
2. 功能實(shí)現(xiàn)的詳細(xì)代碼，仿真實(shí)現(xiàn)，測試用例，邏輯使用說明文檔的編寫；
3. 協(xié)助硬件工程師確定器件選型、對FPGA等芯片的設(shè)計(jì)進(jìn)行討論指導(dǎo)、審查；
4. 項(xiàng)目聯(lián)調(diào)，配合軟件、硬件工程師進(jìn)行各個(gè)接口的調(diào)試，以及與客戶的聯(lián)調(diào)。
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1. 碩士及以上學(xué)歷，碩士及以上學(xué)歷，計(jì)算機(jī)類、電子信息類、電氣類、控制類、自動(dòng)化類、儀器儀表等相關(guān)專業(yè)；
2.熟悉Verilog/VHDL語言；熟悉FPGA的高速接口開發(fā)，包括PCIe、DDR、ADC、DAC、GTX、SRIO等優(yōu)先；
4.具有良好的學(xué)習(xí)能力、溝通能力、文檔書寫能力及上進(jìn)心和自律性。
工作地點(diǎn)
北京豐臺區(qū)中國中鐵建工集團(tuán)西配樓三層
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航天新長征大道科技有限公司北京分公司航天新長征大道科技有限公司是中國航天科技集團(tuán)中國運(yùn)載火箭技術(shù)研究院旗下高新技術(shù)企業(yè)。航天大道公司秉承“聚焦數(shù)據(jù)與智能技術(shù)，持續(xù)為客戶創(chuàng)造價(jià)值”發(fā)展使命，致力于為客戶提供以長征云工業(yè)互聯(lián)網(wǎng)為核心的先進(jìn)、自主、可靠的智能制造與裝備保障系統(tǒng)解決方案、產(chǎn)品和服務(wù)，助推航天智能制造轉(zhuǎn)型升級、助推中國智能制造轉(zhuǎn)型升級。航天大道公司已獲評國家級高新技術(shù)企業(yè)、國家級重點(diǎn)專精特新“小巨人”企業(yè)、國資委“科改示范”企業(yè)、國家雙跨工業(yè)互聯(lián)網(wǎng)平臺、北京2022年冬奧會和冬殘奧會開閉幕式核心系統(tǒng)供應(yīng)商等諸多榮譽(yù)。公司在北京、大連設(shè)立研發(fā)中心，大連、濟(jì)南、西安、成都設(shè)立區(qū)域服務(wù)中心，技術(shù)研發(fā)團(tuán)隊(duì)占總?cè)藬?shù)的75%，985/211院校碩士、博士占比60%以上。公司員工整體年齡結(jié)構(gòu)年輕化，平均年齡30歲，能力和學(xué)歷層次呈現(xiàn)較好的梯隊(duì)結(jié)構(gòu)，是一支創(chuàng)新能力較強(qiáng)的高科技年輕隊(duì)伍。
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