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崗位職責(zé) 1.負(fù)責(zé)超靈敏度光子計(jì)數(shù)圖像傳感器芯片模擬電路的設(shè)計(jì)與優(yōu)化，確保芯片在不同光照條件下（尤其是微光環(huán)境）的高性能模擬信號(hào)處理，滿(mǎn)足產(chǎn)品嚴(yán)苛的技術(shù)指標(biāo)。 2.深度參與從原理圖設(shè)計(jì)到版畫(huà)布局的全流程工作，運(yùn)用深厚的模擬集成電路設(shè)計(jì)知識(shí)，協(xié)同團(tuán)隊(duì)打造高質(zhì)量，保障芯片模擬信號(hào)鏈的穩(wěn)定與高效。 3.基于過(guò)往豐富經(jīng)驗(yàn)，為芯片模擬電路設(shè)計(jì)提供前瞻性的技術(shù)方案與優(yōu)化建議，攻克研發(fā)過(guò)程中的技術(shù)難題，有效縮短研發(fā)周期，助力產(chǎn)品快速推向市場(chǎng)。 4.與團(tuán)隊(duì)緊密協(xié)作，包括但不限于芯片模擬電路設(shè)計(jì)、算法、測(cè)試等，確保模擬電路與整體芯片架構(gòu)無(wú)縫對(duì)接，協(xié)同實(shí)現(xiàn)芯片功能的完整性與穩(wěn)定性 工作內(nèi)容 1. 負(fù)責(zé)cmos image sensor產(chǎn)品中模擬信號(hào)鏈的設(shè)計(jì)，包括列并行ADC、偏置電路、溫度傳感器、信號(hào)驅(qū)動(dòng)器等的設(shè)計(jì)； 2. 指導(dǎo)并配合所設(shè)計(jì)模塊的版圖設(shè)計(jì)，或者協(xié)助版圖工程師進(jìn)行版圖設(shè)計(jì)； 3. 測(cè)試所設(shè)計(jì)的模塊，了解模塊設(shè)計(jì)和芯片指標(biāo)的差異，并解決遇到的問(wèn)題； 4. 配合AE進(jìn)行新產(chǎn)品的評(píng)估測(cè)試 5.跟蹤行業(yè)前沿技術(shù)動(dòng)態(tài)，引入先進(jìn)的模擬電路設(shè)計(jì)理念與方法，持續(xù)提升公司在 CIS 芯片模擬電路設(shè)計(jì)領(lǐng)域的技術(shù)競(jìng)爭(zhēng)力。 任職要求 1．學(xué)歷背景：碩士及以上學(xué)歷，微電子專(zhuān)業(yè)畢業(yè)。碩士需具備3年以上相關(guān)工作經(jīng)驗(yàn)，博士需有1年以上工作經(jīng)驗(yàn)，條件優(yōu)秀者可適當(dāng)放寬。 2．專(zhuān)業(yè)技能： 精通模擬集成電路設(shè)計(jì)，比如設(shè)計(jì)ADC, DAC, PPL, 偏執(zhí)電路，電源管理，高速接口等經(jīng)驗(yàn)的，能夠獨(dú)立承擔(dān)復(fù)雜模擬電路模塊的設(shè)計(jì)任務(wù)。 熟悉模擬電路的版圖設(shè)計(jì)，具備良好的版圖布局與布線技巧，確保版圖的可靠性、可制造性與高性能。 3．要求在專(zhuān)業(yè)的CIS設(shè)計(jì)公司積累了豐富工作經(jīng)驗(yàn)，主導(dǎo)或深度參與過(guò)量產(chǎn)級(jí)CIS芯片的模擬信號(hào)鏈設(shè)計(jì)，對(duì)量產(chǎn)工藝有深入了解，能有效把控產(chǎn)品質(zhì)量與良率。