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更新于 4月27日
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舉報(bào)

信號(hào)處理（FPGA方向）

1.5-2.5萬(wàn)
  • 成都郫都區(qū)
  • 經(jīng)驗(yàn)不限
  • 碩士
  • 全職
  • 招6人

職位描述

MATLABPythonVHDLVerilog通信/網(wǎng)絡(luò)設(shè)備
崗位職責(zé)：
1、負(fù)責(zé)信號(hào)處理算法需求分析、完成導(dǎo)航、通信或雷達(dá)相關(guān)的信號(hào)處理算法方案設(shè)計(jì)與仿真；
2、負(fù)責(zé)設(shè)計(jì)實(shí)現(xiàn)無(wú)限通信、導(dǎo)航等應(yīng)用的物理層相關(guān)算法；
3、負(fù)責(zé)在FPGA上實(shí)現(xiàn)信號(hào)處理算法，負(fù)責(zé)代碼編寫(xiě)、調(diào)試及維護(hù)；
4、負(fù)責(zé)技術(shù)或產(chǎn)品開(kāi)發(fā)各個(gè)階段相關(guān)的技術(shù)評(píng)審和技術(shù)文件編寫(xiě)；
5、解決研制、生產(chǎn)過(guò)程中出現(xiàn)的算法問(wèn)題。
崗位要求：
1、信號(hào)處理、電子、數(shù)學(xué)、導(dǎo)航、計(jì)算機(jī)、自動(dòng)化等相關(guān)專(zhuān)業(yè)；
2、熟練掌握Matlab或Python工具進(jìn)行仿真；
3、熟悉Verilog/VHDL語(yǔ)言；
4、具有FPGA工程實(shí)現(xiàn)相關(guān)項(xiàng)目經(jīng)驗(yàn)優(yōu)先；
5、具有擴(kuò)跳頻設(shè)計(jì)、通信調(diào)制解調(diào)、信道編解碼或雷達(dá)信號(hào)處理算法相關(guān)經(jīng)驗(yàn)者優(yōu)先。

工作地點(diǎn)

郫都區(qū)成都市高新西區(qū)新業(yè)路88號(hào)天奧產(chǎn)業(yè)園

職位發(fā)布者

解女士/招聘主管

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