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崗位內(nèi)容：
1. 設(shè)計數(shù)字電路和FPGA原型，包括架構(gòu)設(shè)計、算法添加和IP集成。
2. 編寫Verilog HDL代碼進行仿真、綜合和布局布線。
3. 完成FPGA驗證測試，并對設(shè)計問題進行排查修復(fù)。
4. 參與產(chǎn)品級FPGA設(shè)計規(guī)格書的制定和執(zhí)行。
任職要求：
1. 具有數(shù)字電路設(shè)計和FPGA開發(fā)經(jīng)驗。熟悉數(shù)字信號處理基礎(chǔ)算法，例如DDC, FFT, FIR，打包傳數(shù)等
2. 熟練掌握HDL編程語言（如Verilog、VHDL）。
3. 熟悉數(shù)字信號處理和可編程邏輯器件。
4. 熟練使用EDA工具，例如Quartus、Vivado等。
5. 具備良好的溝通與團隊協(xié)作能力以及問題解決能力。