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任職資格 候選人最好是在數(shù)字ASIC設計驗證方面至少有3年以上經(jīng)驗的MSEE人。更多經(jīng)驗將被視為高級工程師或領導。 候選人應對ASIC/IP設計流程有很好的理解，并應具備: 0.熟悉主要驗證語言之一:UVM、C、C++、SystemVerilog、Verilog 1.良好的設計驗證方法知識，如UVM或OVM和覆蓋率驅動的驗證方法 2.許多關于仿真模型創(chuàng)建和測試平臺構建的經(jīng)驗 3.用Verilog進行強RTL編碼，熟悉前端設計流程 4.具有以下領域的背景將是一大優(yōu)勢: a.豐富的基于ARM的SoC系統(tǒng)C/C++軟件開發(fā)經(jīng)驗 b.視頻、顯示器、GPU、DDR、PCIe、USB等.. 5.熟悉腳本語言，如Perl，C shell，Makefile。 工作職責 驗證任務包括模塊級、芯片級驗證、測試計劃創(chuàng)建、腳本編寫、覆蓋、回歸運行等..